A.函數(shù)定義中不能包含任何時(shí)序控制語(yǔ)句;
B.函數(shù)至少有一個(gè)輸入,包含任何輸出或雙向端口;
C.函數(shù)只返回一個(gè)數(shù)據(jù),其缺省為reg類型;
D.函數(shù)不能調(diào)用任務(wù),但任務(wù)可以調(diào)用函數(shù)。
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A.在過(guò)程賦值語(yǔ)句中表達(dá)式左邊的信號(hào)一定是寄存器類型
B.過(guò)程塊中的語(yǔ)句一定是可綜合的
C.在過(guò)程塊中,使用過(guò)程賦值語(yǔ)句給wire賦值不會(huì)產(chǎn)生錯(cuò)誤
D.過(guò)程塊中時(shí)序控制的種類有簡(jiǎn)單延遲、邊沿敏感和電平敏感
A.fork…join
B.assign/deassign
C.if…else和case
D.repeat和forever
A.一段式寄存器輸出,易產(chǎn)生毛刺,不利于時(shí)序約束;
B.二段式組合邏輯輸出,不產(chǎn)生毛刺,有利于時(shí)序約束;
C.三段式寄存器輸出,不產(chǎn)生毛刺,有利于時(shí)序約束;
D.所有描述風(fēng)格都是寄存器輸出,易產(chǎn)生毛刺,有利于時(shí)序約束。
A.流水線
B.樹型結(jié)構(gòu)
C.遲置信號(hào)后移
D.資源共享
下列代碼描述中,不能產(chǎn)生時(shí)序邏輯的()
A.A
B.B
C.C
最新試題
四位全加器程序如下,補(bǔ)全程序。
使用case語(yǔ)句實(shí)現(xiàn)四選一多路選擇器。
利用verilog語(yǔ)言設(shè)計(jì)一個(gè)1/2分頻器。
設(shè)計(jì)一個(gè)觸發(fā)器。
半加器的程序如下,補(bǔ)全程序。
設(shè)計(jì)一個(gè)順序脈沖。
設(shè)計(jì)一個(gè)4位計(jì)數(shù)器。
下面是一個(gè)三態(tài)門的程序,其中使能端為en,低電平時(shí),三態(tài)門屬于高阻狀態(tài)。請(qǐng)把缺少的部分補(bǔ)充完整。
編寫一個(gè)4位的全加器。(輸入兩個(gè)加數(shù)a、b;和sum;進(jìn)位輸入cin;進(jìn)位輸出cout)。
編寫一個(gè)2選1多路器。(輸入a,b;輸出out;輸出由sl電平控制0是a、1是b)。