問答題假定最復雜的一條指令所用的組合邏輯分成6塊,依次為A~F,其延遲分別為80ps、30ps、60ps、50ps、70ps、10ps。在這些組合邏輯塊之間插入必要的流水段寄存器就可實現(xiàn)相應的指令流水線,寄存器延遲為20ps。理想情況下,以下各種方式所得到的時鐘周期、指令吞吐率和指令執(zhí)行時間各是多少?應該在哪里插入流水線寄存器?插入一個流水段寄存器,得到一個兩級流水線

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如果N=100,采用指令取消技術后,在程序執(zhí)行過程中,能夠節(jié)省多少個指令周期?

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在編號分別為0,1,2,……,9的16個處理器之間,要求按下列配對通信:(B、1),(8、2),(7、D),(6、C),(E、4),(A、0),(9、3),(5、F)。試選擇所用互連網(wǎng)絡類型、控制方式,并畫出該互連網(wǎng)絡的拓撲結構和各級的交換開關狀態(tài)圖。

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當存儲系統(tǒng)的訪問效率為0.5時,計算命中率和等效訪問周期。

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若傳送106個文字符號,且每個文字符號后均自動跟一個空格,按最短的編碼,共需傳送多少個二進制位?若傳送波特率為9600bPS,共需傳送多少時間?

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畫出其中一組的邏輯圖。

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為了使存儲系統(tǒng)的訪問效率從0.5提高到0.94,塊的大小至少增加到幾個字?

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浮點數(shù)系統(tǒng)使用的階碼基值re=2,階值位數(shù)q=2,尾數(shù)基值rm=10,尾數(shù)位數(shù)p′=1,即按照使用的二進制位數(shù)來說,等價于p=4。計算在非負階、正尾數(shù)、規(guī)格化情況下的最小尾數(shù)值、最大尾數(shù)值、最大階值、可表示的最小值和最大值及可表示數(shù)的個數(shù)。

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有一個16KB4路組相聯(lián)Cache的32位微處理器,假定該Cache的塊為4個32位的字。主存地址為ABCDE8F8的單元在Cache中的什么位置。

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寫出N=8的蝶式置換的互連函數(shù),如采用Omega網(wǎng)絡,則需幾次通過才能完成此變換?畫出Omega網(wǎng)絡實現(xiàn)此變換的控制狀態(tài)圖。

題型:問答題

一臺機器要求浮點數(shù)的字長的精度不低于10-7.2,表數(shù)的范圍正數(shù)不小于1038,且正負對稱。尾數(shù)用原碼、純小數(shù)表示,階碼用移碼、整數(shù)表示。設計這種浮點數(shù)的格式。

題型:問答題