如圖所示的兩級(jí)阻容耦合共射放大電路中,已知uCC=12V,Rb11=30KΩ,Rb22=15KΩ,RC1=3KΩ,RE1=3KΩ,Rb21=20KΩ,Rb22=10K,RC2=2.5KΩ,RE2=2KΩ,RL=5KΩ,β1=β2=50。試求:
(1)各級(jí)靜態(tài)工作點(diǎn);
(2)畫出微變等效電路;
(3)各級(jí)電壓放大倍數(shù)Au1、Au2及總的電壓放大倍數(shù)Au;
(4)各級(jí)輸入、輸出電阻Ri1、Ro1、Ri2、Ro2。
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已知某N溝道增強(qiáng)型MOS場效應(yīng)管的。下表給出了四種狀態(tài)下和的值,那么各狀態(tài)下器件的工作狀態(tài)為()。
現(xiàn)在定義了一個(gè)1位的加法器addbit(ci,a,b,co,sum),模塊的結(jié)果用表達(dá)式表示為{co,sub}=a+b+ci,其中a,b為兩個(gè)加數(shù),ci為來自低位的進(jìn)位,sum為和,co為向高位的進(jìn)位,如果以此1位加法器構(gòu)建四位加法器,同時(shí)定義頂層模塊中的端口信號(hào)和中間變量的定義:下面通過層次調(diào)用的方式進(jìn)行邏輯實(shí)現(xiàn)中的表達(dá)式正確的是()。
在下圖中如果輸入輸出均有電容耦合,則將RG的阻值由10MΩ替換為1MΩ時(shí),柵極直流電壓將會(huì)(),漏極直流電流將會(huì)(),輸入電阻將會(huì)()。
?5.1K±5%歐姆的五環(huán)電阻的色環(huán)序列為()。
?verilogHDL的基本結(jié)構(gòu)中通常需要進(jìn)行模塊范圍的定義,VerilogHDL的模塊范圍的定義的開始和結(jié)束方式是()。
?CS、CG和CD三種組態(tài)中,最適合做電壓放大器的還是CS放大器。
?CS放大器中引入源極電阻RS,其作用有()。?
CG放大器具有較()的輸入電阻和較()的輸出電阻。?
當(dāng)VGS=0時(shí),能夠?qū)ǖ腗OS管為()
?CD放大器的性能特征有()。?