邏輯電路如圖所示,A="1"時(shí),C脈沖來(lái)到后,D觸發(fā)器應(yīng):()
A.具有計(jì)數(shù)器功能
B.置"0"
C.置"1"
D.無(wú)法確定
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圖為三個(gè)二極管和電阻R組成一個(gè)基本邏輯門(mén)電路,輸入二極管的高電平和低電平分別是3V和0V,電路的邏輯關(guān)系式是:()
A.Y=ABC
B.Y=A+B+C
C.Y=AB+C
D.Y=(A+B.C
(2005)圖示電路中,二極管視為理想元件,即正向電壓降為零,反向電阻為無(wú)窮大。三極管的β=100。輸入信號(hào)UA、UB的高電平是3.5V,(邏輯1),低電平是0.3V(邏輯0),若該電路的輸出電壓U0為電壓平時(shí)定為邏輯1,圖7-10-8所示電路應(yīng)為:()
A.與門(mén)
B.與非門(mén)
C.或門(mén)
D.或非門(mén)
(2007)圖示電路具有:()
A.保持功能
B.置"0"功能
C.置"1"功能
D.計(jì)數(shù)功能
(2008)如圖所示電路中,Q1、Q2的原始狀態(tài)為"11"當(dāng)送入兩個(gè)脈沖后的新?tīng)顟B(tài)為:()
A."00"
B."01"
C."11"
D."10"
(2010)由JK觸發(fā)器組成的應(yīng)用電器如圖所示,設(shè)觸發(fā)器的初值都為0,經(jīng)分析可知是一個(gè):()
A.同步二進(jìn)制加法計(jì)算器
B.同步四進(jìn)制加法計(jì)算器
C.同步三進(jìn)制加法計(jì)算器
D.同步三進(jìn)制減法計(jì)算器
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