單項(xiàng)選擇題A/D轉(zhuǎn)換器的誤差（）。

A.只取決于分辨率
B.基本上是量化誤差
C.與工作中的各個(gè)環(huán)節(jié)都有關(guān)系
D.往往不可預(yù)測(cè)


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1.單項(xiàng)選擇題可編程邏輯陣列PLA可以實(shí)現(xiàn)用（）表示的邏輯電路。

A.與非－與非表達(dá)式
B.或非－或非表達(dá)式
C.與—或—非表達(dá)式
D.標(biāo)準(zhǔn)與—或表達(dá)式

2.單項(xiàng)選擇題PLD開(kāi)發(fā)系統(tǒng)不需要（）。

A.計(jì)算機(jī)
B.燒錄器
C.仿真器
D.開(kāi)發(fā)軟件

3.單項(xiàng)選擇題CUPL語(yǔ)言中$是什么運(yùn)算符（）。

A.與運(yùn)算符
B.或運(yùn)算符
C.異或運(yùn)算符
D.求補(bǔ)運(yùn)算符

4.單項(xiàng)選擇題下列器件的輸出電路可編程的是（）。

A.PAL
B.GAL
C.PROM
D.PLA

5.單項(xiàng)選擇題可重復(fù)編程的可編程器件有（）。

A.PAL
B.GAL
C.PROM
D.PLA

最新試題

（）在計(jì)算機(jī)系統(tǒng)中得到了廣泛的應(yīng)用，其中一個(gè)重要用途是構(gòu)成數(shù)據(jù)總線。

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試提出數(shù)字頻率計(jì)的三種設(shè)計(jì)方案，比較各種方案的特點(diǎn)。如果用HDPLD來(lái)實(shí)現(xiàn)，設(shè)計(jì)方案是最佳嗎？簡(jiǎn)述理由。

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要使JK觸發(fā)器的輸出Q從1就成0，它的輸入信號(hào)JK就為（）。

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用1M×4的DRAM芯片通過(guò)（）擴(kuò)展可以獲得4M×8的存儲(chǔ)器。

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若停電數(shù)分鐘后恢復(fù)供電，（）中的信息能夠保持不變。

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基本RS觸發(fā)器的輸入直接控制其輸出狀態(tài)，所以它不能被稱(chēng)為（）觸發(fā)器。

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TTL與非門(mén)閾值電壓UT的典型值是（）

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如要將一個(gè)最大幅度為5.1V的模擬信號(hào)轉(zhuǎn)換為數(shù)字信號(hào)，要求輸入每變化20mV，輸出信號(hào)的最低位（LSB）發(fā)生變化，應(yīng)選用（）位ADC。

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用原碼輸出的譯碼器實(shí)現(xiàn)多輸出邏輯函數(shù)，需要增加若干個(gè)（）。

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TTL與非門(mén)輸出低電平的參數(shù)規(guī)范值是（）

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