A.設(shè)計(jì)合理的外電路(抗飽和電路)
B.加大UBE
C.選擇開(kāi)關(guān)時(shí)間較小的管子
D.減小UBE
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A.74LS00
B.74LS04
C.CD4511
D.CD4017
A.集電極開(kāi)路
B.三態(tài)門輸出
C.圖騰柱輸出
D.復(fù)合管和圖騰柱輸出
A.與門
B.與非門
C.非門
D.或門
A.接地
B.接電源
C.懸空
D.與使用端并聯(lián)
A.接地
B.接電源
C.懸空
D.與使用端并聯(lián)
最新試題
什么是觸發(fā)器的不定狀態(tài),如何避免不定狀態(tài)的出現(xiàn)?
()在計(jì)算機(jī)系統(tǒng)中得到了廣泛的應(yīng)用,其中一個(gè)重要用途是構(gòu)成數(shù)據(jù)總線。
ROM可以用來(lái)存儲(chǔ)程序、表格和大量固定數(shù)據(jù),但它不可以用來(lái)實(shí)現(xiàn)()。
雙積分型數(shù)字電壓表是否需要取樣-保持電路?請(qǐng)說(shuō)明理由。
采用浮柵技術(shù)的EPROM中存儲(chǔ)的數(shù)據(jù)是()可擦除的。
如要將一個(gè)最大幅度為5.1V的模擬信號(hào)轉(zhuǎn)換為數(shù)字信號(hào),要求輸入每變化20mV,輸出信號(hào)的最低位(LSB)發(fā)生變化,應(yīng)選用()位ADC。
利用2個(gè)74LS138和1個(gè)非門,可以擴(kuò)展得到1個(gè)()線譯碼器。
判斷如下VHDL的操作是否正確,如不正確,請(qǐng)改正。字符a和b的數(shù)據(jù)類型是BIT,c是INTEGER,執(zhí)行c<=a+b。
要使JK觸發(fā)器的輸出Q從1就成0,它的輸入信號(hào)JK就為()。
一個(gè)兩輸入端的門電路,當(dāng)輸入為10時(shí),輸出不是1的門電路為()