多項(xiàng)選擇題同步T觸發(fā)器具有（）功能。

A.保持（記憶）
B.置0
C.置1
D.翻轉(zhuǎn)（計(jì)數(shù)）


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1.多項(xiàng)選擇題同步D觸發(fā)器具有（）功能。

A.保持記憶
B.狀態(tài)不定
C.送0
D.送1

3.多項(xiàng)選擇題基本RS觸發(fā)器可用于（）。

A.鍵盤(pán)輸入
B.開(kāi)關(guān)消噪
C.防抖動(dòng)
D.數(shù)據(jù)運(yùn)算

4.多項(xiàng)選擇題基本RS觸發(fā)器具有（）。

A.置0
B.置1
C.保持記憶
D.裝態(tài)不定

5.多項(xiàng)選擇題根據(jù)邏輯功能的不同，觸發(fā)器可分為RS觸發(fā)器、（）。

A.D觸發(fā)器
B.同步觸發(fā)器
C.JK觸發(fā)器
D.T和T’觸發(fā)器

最新試題

一個(gè)VHDL模塊是否必須有一個(gè)實(shí)體和一個(gè)結(jié)構(gòu)體？是否可以有多個(gè)實(shí)體和結(jié)構(gòu)體？簡(jiǎn)述它們的作用。

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如要將一個(gè)最大幅度為5.1V的模擬信號(hào)轉(zhuǎn)換為數(shù)字信號(hào)，要求輸入每變化20mV，輸出信號(hào)的最低位（LSB）發(fā)生變化，應(yīng)選用（）位ADC。

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什么是觸發(fā)器的空翻現(xiàn)象，如何避免空翻？

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10-4線優(yōu)先編碼器允許同時(shí)輸入（）路編碼信號(hào)。

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要使JK觸發(fā)器的輸出Q從1就成0，它的輸入信號(hào)JK就為（）。

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簡(jiǎn)述用譯碼器或多路選擇器實(shí)現(xiàn)組合邏輯電路的不同之處。

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試提出數(shù)字頻率計(jì)的三種設(shè)計(jì)方案，比較各種方案的特點(diǎn)。如果用HDPLD來(lái)實(shí)現(xiàn)，設(shè)計(jì)方案是最佳嗎？簡(jiǎn)述理由。

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小容量RAM內(nèi)部存儲(chǔ)矩陣的字?jǐn)?shù)與外部地址線數(shù)n的關(guān)系一般為（）

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兩個(gè)與非門(mén)構(gòu)成的基本RS觸發(fā)器，當(dāng)Q=1、Q=0時(shí)，兩個(gè)輸入信號(hào)R=1和S=1。觸發(fā)器的輸出Q會(huì)（）。

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判斷如下VHDL的操作是否正確，如不正確，請(qǐng)改正。字符a和b的數(shù)據(jù)類(lèi)型是BIT，c是INTEGER，執(zhí)行c＜=a+b。

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