A.程序計數(shù)器
B.指令寄存器
C.地址寄存器
D.地址譯碼器
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A.程序計數(shù)器
B.指令寄存器
C.地址寄存器
D.地址譯碼器
A.3個階段執(zhí)行時間之和
B.3個階段執(zhí)行時間的平均值
C.3個階段執(zhí)行時間的最小值
D.3個階段執(zhí)行時間的最大值
A.為0
B.為1個周期
C.相等
D.不等
A.順序
B.重疊
C.循環(huán)
D.并行
A.由軟件實現(xiàn)，考慮到實現(xiàn)很簡便
B.由硬件實現(xiàn)，考慮到實現(xiàn)速度要快
C.由軟件和硬件組合實現(xiàn)，考慮到性價比要高
D.既可以用軟件實現(xiàn)，也可以用硬件實現(xiàn)，考慮到實現(xiàn)的靈活性
最新試題
在高速計算機中，廣泛采用流水線技術(shù)。例如，可以將指令執(zhí)行分成取指令、分析指令和執(zhí)行指令3個階段，不同指令的不同階段可以（1）執(zhí)行；各階段的執(zhí)行時間最好（2）；否則在流水線運行時，每個階段的執(zhí)行時間應(yīng)取（3）。空白（2）處應(yīng)選擇（）
在高速計算機中，廣泛采用流水線技術(shù)。例如，可以將指令執(zhí)行分成取指令、分析指令和執(zhí)行指令3個階段，不同指令的不同階段可以（1）執(zhí)行；各階段的執(zhí)行時間最好（2）；否則在流水線運行時，每個階段的執(zhí)行時間應(yīng)?。?）?？瞻祝?）處應(yīng)選擇（）
運算器是CPU的核心部件之一，其主要功能是（）。
在計算機中，保存當(dāng)前正在執(zhí)行的指令的寄存器為（1），存放當(dāng)前指令地址的寄存器叫（2）。在順序執(zhí)行指令的情況下（存儲器按字節(jié)編址，指令字長32位），每執(zhí)行一條指令，使程序計數(shù)器自動加（3）。算術(shù)邏輯運算的結(jié)果通常放在（4）中。空白（1）處應(yīng)選擇（）
下列部件中不屬于輸入設(shè)備的有（1）。既可作為輸入設(shè)備，又可以作為輸出設(shè)備的是（2）?？瞻祝?）處應(yīng)選擇（）
PCI總線是計算機中一種非常重要的外部總線，從數(shù)據(jù)寬度上看，PCI總線有32b、64b之分；從總線速度上分，有33MHz、66MHz兩種。經(jīng)過改良后的PCI-X，最高可以達到64b@133MHz，其數(shù)據(jù)傳輸速率為（）。
單地址指令中為了完成兩個數(shù)的算術(shù)運算，除地址碼指明的一個操作數(shù)外，另一個數(shù)常需采用（）。
計算機的存儲器采用多級方式是為了（）。
在計算機中，保存當(dāng)前正在執(zhí)行的指令的寄存器為（1），存放當(dāng)前指令地址的寄存器叫（2）。在順序執(zhí)行指令的情況下（存儲器按字節(jié)編址，指令字長32位），每執(zhí)行一條指令，使程序計數(shù)器自動加（3）。算術(shù)邏輯運算的結(jié)果通常放在（4）中?？瞻祝?）處應(yīng)選擇（）
在計算機中，保存當(dāng)前正在執(zhí)行的指令的寄存器為（1），存放當(dāng)前指令地址的寄存器叫（2）。在順序執(zhí)行指令的情況下（存儲器按字節(jié)編址，指令字長32位），每執(zhí)行一條指令，使程序計數(shù)器自動加（3）。算術(shù)邏輯運算的結(jié)果通常放在（4）中?？瞻祝?）處應(yīng)選擇（）