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A.21
B.20
C.18
D.16
A.并行
B.串行
C.分時(shí)
D.并串行
A.當(dāng)代流行總線結(jié)構(gòu)不是標(biāo)準(zhǔn)總線
B.當(dāng)代總線結(jié)構(gòu)中，CPU和它私有的cache一起作為一個(gè)模塊與總線相連
C.系統(tǒng)中只允許有一個(gè)這樣的CPU模塊
D.總線是處理器引腳的延伸
最新試題
若在程序執(zhí)行過(guò)程中，每從主存裝入一塊到Cache，平均要對(duì)這個(gè)塊訪問(wèn)16次，計(jì)算在這種情況下的Cache命中率。
畫(huà)出流水線任務(wù)調(diào)度的狀態(tài)有向圖。
如果N=100，采用指令取消技術(shù)后，在程序執(zhí)行過(guò)程中，能夠節(jié)省多少個(gè)指令周期？
為了使存儲(chǔ)系統(tǒng)的訪問(wèn)效率從0.5提高到0.94，塊的大小至少增加到幾個(gè)字？
畫(huà)出其中一組的邏輯圖。
若采用LRU替換算法，計(jì)算Cache的塊命中率。
有一個(gè)16KB4路組相聯(lián)Cache的32位微處理器，假定該Cache的塊為4個(gè)32位的字。主存地址為ABCDE8F8的單元在Cache中的什么位置。
寫(xiě)出N=8的蝶式置換的互連函數(shù)，如采用Omega網(wǎng)絡(luò)，則需幾次通過(guò)才能完成此變換？畫(huà)出Omega網(wǎng)絡(luò)實(shí)現(xiàn)此變換的控制狀態(tài)圖。
若Cache的4個(gè)塊號(hào)為C0、C1、C2和C3，列出程序執(zhí)行過(guò)程中的Cache塊地址流。
求出流水線的最優(yōu)調(diào)度策略及最小平均延遲時(shí)間和流水線的最大吞吐率。