電路如下圖所示,當(dāng)晶體管的β由50變?yōu)?00時(shí),則電路的輸入電阻()
A.不變;
B.減小很多;
C.增大為原來的4倍;
D.接近原來的2倍。
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電路如下圖所示,當(dāng)晶體管的β由50變?yōu)?00時(shí),則電路的電壓放大倍數(shù)()
A.約為原來的1/2;
B.基本不變;
C.約為原來的2倍;
D.約為原來的4倍。
電路如下圖所示,U0與Ui的相位關(guān)系為()
A.U0與Ui同相;
B.U0落后于Ui90°;
C.U0落后于Ui180°;
D.U0領(lǐng)先于Ui135°。
電路如圖所示,接法錯(cuò)誤的是()
A.電源極性接反;
B.基極被短路;
C.信號(hào)不能輸出;
D.C1接反,Rb可不接。
放大電路如圖所示,該電路的輸出電阻為()
A.RL;
B.Rc∥RL;
C.rce+Re;
D.Rc。
放大電路如圖所示,該電路的輸入電阻為()
A.Rb;
B.Rb∥Rc;
C.Rb∥[rbe+Re];
D.Rb∥[rbe+(1+β)Re]。
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