A.ICW1
B.OCW1
C.OCW2
D.OCW3
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A.屏蔽所有中斷
B.設(shè)置最低優(yōu)先級(jí)
C.開(kāi)發(fā)低級(jí)中斷
D.響應(yīng)同級(jí)中斷
A.發(fā)出中斷結(jié)束命令，使相應(yīng)的ISR=1
B.發(fā)出中斷結(jié)束命令，使相應(yīng)的ISR=0
C.發(fā)出中斷結(jié)束命令，使相應(yīng)的IMR=1
D.發(fā)出中斷結(jié)束命令，使相應(yīng)的IMR=0
A.28H
B.2BH
C.2CH
D.2DH
A.寫(xiě)在中斷指令中
B.在執(zhí)行中斷指令前賦給AH
C.在執(zhí)行中斷指令前賦給AX
D.在執(zhí)行中斷指令前賦給DL
A.FLAGS寄存器（FR）先入棧，其次是CS，最后是IP
B.CS在先，其次是IP，最后FR入棧
C.FR在先，其后一次是IP，最后CS
D.IP在先，其次是CS，最后FR
最新試題
在一個(gè)較短的時(shí)間間隔內(nèi)，CPU訪(fǎng)問(wèn)存儲(chǔ)器時(shí)，無(wú)論是存取指令還是存取數(shù)據(jù)，所訪(fǎng)問(wèn)的存儲(chǔ)單元都趨于聚集在一個(gè)較小的連續(xù)區(qū)域中，而對(duì)此范圍以外的地址訪(fǎng)問(wèn)甚少的現(xiàn)象就稱(chēng)為程序訪(fǎng)問(wèn)的（）性。
8086CPU讀取外設(shè)端口數(shù)據(jù)時(shí)，一次可以讀取16位二進(jìn)制數(shù)。（）
某存儲(chǔ)器系統(tǒng)要求采用3：8譯碼器對(duì)A19~A15進(jìn)行全譯碼，需要（）片。
8255A的端口地址線(xiàn)是A0、A1，所以端口地址為0，1，2，3。（）
在查詢(xún)式輸出接口典型電路中，數(shù)據(jù)端口地址和狀態(tài)端口地址可以是相同地址。（）
增計(jì)數(shù)模式的計(jì)數(shù)過(guò)程是（）。
在IN和OUT指令中，當(dāng)端口號(hào)大于FFH（255）時(shí)，必須通過(guò)（）間接給出。
容量為8K×8bit的存儲(chǔ)器芯片，該芯片的地址線(xiàn)有（）根，數(shù)據(jù)線(xiàn)有（）根。
按照是否需要刷新操作分類(lèi)，RAM可分為（）和（）。
STM32的I2C總線(xiàn)開(kāi)啟一次后可以連續(xù)傳輸任意字節(jié)的數(shù)據(jù)，而無(wú)需發(fā)送設(shè)備的地址號(hào)。