單項(xiàng)選擇題在VHDL語(yǔ)言中，信號(hào)賦值語(yǔ)句使用的代入符是（）

A.=
B.：=
C.＜=
D.==


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1.單項(xiàng)選擇題在VHDL語(yǔ)言中，不同類(lèi)型的數(shù)據(jù)是（）的。

A.可以進(jìn)行運(yùn)算和直接代入
B.不能進(jìn)行運(yùn)算和直接代入
C.不能進(jìn)行運(yùn)算但可以直接代入
D.可以進(jìn)行運(yùn)算但不能直接代入

3.單項(xiàng)選擇題結(jié)構(gòu)體中的變量應(yīng)在VHDL程序中（）部分給予說(shuō)明。

A.結(jié)構(gòu)體對(duì)應(yīng)的實(shí)體的端口表中
B.結(jié)構(gòu)體中關(guān)鍵詞BEGIN前
C.結(jié)構(gòu)體中關(guān)鍵詞BEGIN后
D.程序包（PACKAGE）

4.多項(xiàng)選擇題在VHDL程序中，以下4個(gè)部分，（）可以有順序執(zhí)行語(yǔ)句。

A.結(jié)構(gòu)體（ARCHITECTURE）
B.進(jìn)程（PROCESS）中的關(guān)鍵詞BEGIN前
C.進(jìn)程（PROCESS）中的關(guān)鍵詞BEGIN后
D.程序包（PACKAGE）

6.單項(xiàng)選擇題在VHDL語(yǔ)言中，ARCHITECTURE中的語(yǔ)句都是（）執(zhí)行的語(yǔ)句。

A.順序
B.并行
C.即可順序也可并行
D.無(wú)法確定

7.多項(xiàng)選擇題結(jié)構(gòu)體（ARCHITECTURE）用于描述設(shè)計(jì)單元的（）

A.行為、元件及連接關(guān)系
B.元件、子程序、公用數(shù)據(jù)類(lèi)型
C.名稱(chēng)和端口的引腳等
D.可編譯的設(shè)計(jì)單元

8.多項(xiàng)選擇題實(shí)體（ENTITY）描述一個(gè)設(shè)計(jì)單元的（）的信息。

A.行為、元件及連接關(guān)系
B.元件、子程序、公用數(shù)據(jù)類(lèi)型
C.名稱(chēng)和端口的引腳等
D.可編譯的設(shè)計(jì)單元

9.多項(xiàng)選擇題在邏輯代數(shù)中，下列推斷正確的是（）。

A、如果a+b=a+c，則b=c
B、如果ab=ac，則b=c
C、如果a*a=1，則a=1
D、如果a+a=a，則a=1

10.多項(xiàng)選擇題下列觸發(fā)器抗干擾能力較強(qiáng)的觸發(fā)器是（）。

A.基本RS觸發(fā)器
B.同步D觸發(fā)器
C.主從JK觸發(fā)器
D.維持－阻塞D觸發(fā)器

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