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A.可作電壓跟隨器使用
B.可用于多級電路中做緩沖器，進(jìn)行阻抗變換
C.良好的參數(shù)特性使其非常適合用于單級電壓放大
D.良好的參數(shù)特性使其非常適合用于單級電流放大
A.穩(wěn)定靜態(tài)工作點(diǎn)
B.控制器件輸入信號vgs的大小，避免因vi過大產(chǎn)生非線性失真
C.降低電壓增益
D.提高輸入輸出電阻
A.對電壓信號有極好的放大作用
B.對電流信號有極好的放大作用
C.有較高的輸入輸出電阻
D.可用作電流跟隨器
A.CS組態(tài)
B.源極帶電阻的CS組態(tài)
C.CG組態(tài)
D.CD組態(tài)
A.不太高的電壓增益
B.較高的輸入電阻
C.較高的輸出電阻
D.較高的帶寬
最新試題
一塊通用面包板，公共條是三?四?三分段連通型，那么這塊板上最多有（）個(gè)插孔在內(nèi)部是連通在一起的。
?TTL或非門組成的邏輯電路如圖所示，當(dāng)輸入為以下哪種狀態(tài)時(shí)會(huì)出現(xiàn)冒險(xiǎn)現(xiàn)象？（）
用作電壓放大器時(shí)，CS放大器不合適的參數(shù)為（）。?
現(xiàn)在定義了一個(gè)1位的加法器addbit（ci，a，b，co，sum），模塊的結(jié)果用表達(dá)式表示為{co，sub}=a+b+ci，其中a，b為兩個(gè)加數(shù)，ci為來自低位的進(jìn)位，sum為和，co為向高位的進(jìn)位，如果以此1位加法器構(gòu)建四位加法器，同時(shí)定義頂層模塊中的端口信號和中間變量的定義：下面通過層次調(diào)用的方式進(jìn)行邏輯實(shí)現(xiàn)中的表達(dá)式正確的是（）。
CD放大器具有較（）的輸入電阻和較（）的輸出電阻。?????
?若某放大器的輸入信號為電壓信號，輸出信號為電流信號，則以下描述正確的有（）。?
?verilogHDL中已經(jīng)預(yù)先定義了的門級原型的符號有（）。
?10進(jìn)制計(jì)數(shù)器模塊在數(shù)字鐘系統(tǒng)中可作為以下哪些模塊的子模塊？（）
?verilog語法中，間隔符號主要包括（）。
?CS、CG和CD三種組態(tài)中，最適合做電壓放大器的還是CS放大器。