A.機(jī)器校驗(yàn)中斷
B.I/O中斷
C.程序性中斷
D.外中斷
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A.訪管中斷
B.外中斷
C.機(jī)器校驗(yàn)中斷
D.程序性中斷
A.程序控制I/O方式
B.DMA方式
C.外圍處理機(jī)方式
D.通道方式
A.一致性
B.局部性
C.包含性
D.平均性
A.一致性比較好
B.可靠性較高
C.操作過程簡單
D.Cache的更新速度較高。
A.Cache的更新速度較高。
B.一致性比較好，可靠性較高，操作過程簡單。
C.Cache與主存之間的通信量大大降低。
D.Cache的命中率較高。
最新試題
若采用FIFO替換算法，計(jì)算Cache的塊命中率。
畫出流水線任務(wù)調(diào)度的狀態(tài)有向圖。
如果N=100，采用指令取消技術(shù)后，在程序執(zhí)行過程中，能夠節(jié)省多少個(gè)指令周期？
考慮題目全部要求，設(shè)計(jì)優(yōu)化實(shí)用的操作碼形式，并計(jì)算其操作碼的平均碼長。
若在程序執(zhí)行過程中，每從主存裝入一塊到Cache，平均要對這個(gè)塊訪問16次，計(jì)算在這種情況下的Cache命中率。
如果把一條指令的執(zhí)行過程分解為“取指令”、“分析”（包括譯碼和取操作數(shù)等）和“執(zhí)行”（包括運(yùn)算和寫回結(jié)果等）三個(gè)階段，并采用三級流水線。仍然要采用指令取消技術(shù)，請修改上面的程序。
指出訪存操作數(shù)地址尋址的最大相對位移量為多少個(gè)字節(jié)？
有一個(gè)16KB4路組相聯(lián)Cache的32位微處理器，假定該Cache的塊為4個(gè)32位的字。主存地址為ABCDE8F8的單元在Cache中的什么位置。
指出主存與Cache之間各個(gè)塊的映象關(guān)系。
求出流水線的最優(yōu)調(diào)度策略及最小平均延遲時(shí)間和流水線的最大吞吐率。