A.編碼器
B.譯碼器
C.全加器
D.半加器
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A.觸發(fā)器
B.計數(shù)器
C.數(shù)據(jù)選擇器
D.譯碼器
A.電路不是最簡
B.電路有多個輸出
C.電路中存在延遲
D.電路使用不同的門電路
A.真值表
B.狀態(tài)表
C.狀態(tài)圖
D.特性方程
A.觸發(fā)器
B.計數(shù)器
C.數(shù)據(jù)選擇器
D.寄存器
A.與非門
B.或非門
C.與門
D.或門
A.與非門
B.或非門
C.與門
D.或門
A.2個
B.4個
C.8個
D.16個
A.發(fā)射結(jié)正偏置,集電結(jié)反偏置
B.發(fā)射結(jié)正偏置,集電結(jié)正偏置
C.發(fā)射結(jié)反偏置,集電結(jié)正偏置
D.發(fā)射結(jié)反偏置,集電結(jié)反偏置
A.與有用輸入端連在一起
B.懸空
C.接正電源
D.接地
A.與非門
B.或非門
C.OC門
D.三態(tài)門
最新試題
以下哪個編碼不能是二-十進(jìn)制譯碼器的輸入編碼()
試提出數(shù)字頻率計的三種設(shè)計方案,比較各種方案的特點。如果用HDPLD來實現(xiàn),設(shè)計方案是最佳嗎?簡述理由。
采用浮柵技術(shù)的EPROM中存儲的數(shù)據(jù)是()可擦除的。
如要將一個最大幅度為5.1V的模擬信號轉(zhuǎn)換為數(shù)字信號,要求輸入每變化20mV,輸出信號的最低位(LSB)發(fā)生變化,應(yīng)選用()位ADC。
與倒T形電阻網(wǎng)絡(luò)DAC相比,權(quán)電流網(wǎng)絡(luò)D/A轉(zhuǎn)換器的主要優(yōu)點是消除了()對轉(zhuǎn)換精度的影響。
用1M×4的DRAM芯片通過()擴(kuò)展可以獲得4M×8的存儲器。
如果把D觸發(fā)器的輸出Q反饋連接到輸入D,則輸出Q的脈沖波形的頻率為CP脈沖頻率f的()。
27系列EPROM存儲的數(shù)據(jù)是()可擦除的。
一個16選一的數(shù)據(jù)選擇器,其地址輸入(選擇控制輸入)端有()個。
簡述用譯碼器或多路選擇器實現(xiàn)組合邏輯電路的不同之處。