單項(xiàng)選擇題組合邏輯控制是一種硬布線控制,組合邏輯線路是其核心,它接收的輸入信號不包括()

A.指令譯碼器的輸出
B.時(shí)序信號
C.執(zhí)行部件的反饋信息
D.AC的運(yùn)算結(jié)果


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1.單項(xiàng)選擇題在同步控制方式中,由于執(zhí)行簡單指令時(shí)會浪費(fèi)時(shí)間,下列哪種方案將不會使用()

A.不定長指令周期、定長CPU周期
B.定長指令周期
C.定長CPU周期、定長節(jié)拍電位

2.單項(xiàng)選擇題節(jié)拍電位發(fā)生器由循環(huán)移位寄存器和()組成。

A.觸發(fā)器
B.譯碼器
C.計(jì)數(shù)器
D.鎖存器

4.單項(xiàng)選擇題CPU中的ALU主要完成()

A.地址變換
B.中斷管理
C.產(chǎn)生各種時(shí)序
D.算術(shù)邏輯運(yùn)算及移位操作

5.單項(xiàng)選擇題可以暫存運(yùn)算結(jié)果的寄存器是()

A.指令寄存器
B.地址寄存器
C.程序計(jì)數(shù)器
D.通用寄存器

最新試題

寫出X=10111101的補(bǔ)碼表示,正確結(jié)果為()。

題型:單項(xiàng)選擇題

使用硬件堆棧時(shí),其中()移動(dòng)。

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若I/O類指令采用獨(dú)立編址,對系統(tǒng)帶來的影響主要是()。

題型:單項(xiàng)選擇題

從給定的選項(xiàng)中選擇你認(rèn)為正確的一項(xiàng)。A.半加器B.全加器C.原碼D.補(bǔ)碼E.數(shù)據(jù)校驗(yàn)F.檢查溢出G.正確H.錯(cuò)誤I.異或J.與或(1)加法器是由()和相應(yīng)的邏輯電路組成的。(2)定點(diǎn)數(shù)的加減法可以由帶符號位的原碼、反碼和補(bǔ)碼直接參與運(yùn)算,其中()加減法運(yùn)算的實(shí)現(xiàn)規(guī)則最簡單,電路實(shí)現(xiàn)也最方便。(3)執(zhí)行補(bǔ)碼加減法運(yùn)算一定要(),否則無法確定是否正確。(4)使用雙符號位執(zhí)行加減法運(yùn)算后,若兩個(gè)符號位不同,即出現(xiàn)01和10,表示運(yùn)算結(jié)果()。(5)在數(shù)值運(yùn)算中數(shù)值位向符號位進(jìn)位,或符號位向更高位進(jìn)位產(chǎn)生的溢出,可以用這兩個(gè)進(jìn)位輸出的()操作來判斷。

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已知定點(diǎn)小數(shù)的真值X=-0.1001,Y=0.1101,求[X -Y]補(bǔ),正確結(jié)果為()。

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從6管的SRAM記憶單元到單管的DRAM記憶單元,有利于提高()。

題型:單項(xiàng)選擇題

從給定的選項(xiàng)中選擇你認(rèn)為正確的一項(xiàng)。A.讀取指令B.指令譯碼C.下一條指令地址的計(jì)算D.數(shù)據(jù)計(jì)算E.控制器設(shè)計(jì)簡單F.控制器設(shè)計(jì)復(fù)雜(1)一個(gè)指令周期中,()是每一條指令都必須執(zhí)行的,所完成的功能對所有指令都相同。(2)一個(gè)指令周期中,()對多數(shù)指令所完成的功能是類似的。(3)一條指令在執(zhí)行過程中,一定要完成()并保存,以保證程序自動(dòng)連續(xù)執(zhí)行。(4)指令采取順序方式執(zhí)行的優(yōu)點(diǎn)是()。(5)指令流水線方式是提高計(jì)算機(jī)硬件性能的重要技術(shù)和有效措施,但它的()。

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將十六進(jìn)制數(shù)(1A5)16轉(zhuǎn)換為十進(jìn)制數(shù),正確結(jié)果為()。

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柵極電平只能維持一段時(shí)間,若要維持所保存的信息,需要對C1、C2電容充電,此過程被稱為“刷新(refresh)”。刷新過程也就是讀出過程,但只為完成充電而并不需要讀出信息,定期執(zhí)行一次()。

題型:單項(xiàng)選擇題