I=0.5mA，Vt=1.5V，k′n（W/L）=1mA/V2，VA足夠大。輸入輸出信號均通過電容耦合進行傳輸（注意圖中未畫出電容），要實現(xiàn)增益為15倍的放大電路，則RD=（）kΩ。
?
A.10
B.15
C.12.5
D.8
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?電路如圖所示，如果電容C2開路，則MOSFET的漏極直流電壓將會（），漏極交流電壓將會（），增益將會（）。
A.不變，增大，增大
B.不變，減小，減小
C.增大，減小，不變
D.增大，不變，減小
在下圖中如果輸入輸出均有電容耦合，則將RG的阻值由10MΩ替換為1MΩ時，柵極直流電壓將會（），漏極直流電流將會（），輸入電阻將會（）。
A.增大，不變，減小
B.不變，增大，不變
C.不變，不變，減小
D.增大，不變，增大
A.高，高
B.高，低
C.低，高
D.低，低
A.高，高
B.高，低
C.低，高
D.低，低
最新試題
已知某N溝道增強型MOS場效應(yīng)管的。下表給出了四種狀態(tài)下和的值，那么各狀態(tài)下器件的工作狀態(tài)為（）。
?verilog語法中，間隔符號主要包括（）。
可以通過新增以下哪些類型文件添加ChipScope調(diào)試IP核？（）
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當(dāng)VGS=0時，能夠?qū)ǖ腗OS管為（）
?在使用verilog描述一個二選一的數(shù)據(jù)選擇器時，使用一條語句來進行描述assign out1=（sel &b）∣（~sel &a），這條語句對應(yīng)的是（）。
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CG放大器因其輸入電阻過小，因此沒什么用處。
?TTL或非門組成的邏輯電路如圖所示，當(dāng)輸入為以下哪種狀態(tài)時會出現(xiàn)冒險現(xiàn)象？（）