如圖所示的電路,已知:RS=100,R=1K,RL=2K,Rf=19K,試求:
(1)在電路圖上標(biāo)出瞬時(shí)極性,并指出何種類型的交流反饋?
(2)負(fù)反饋對放大電路性能起什么作用?
(3)電路的反饋系數(shù)多大?
(4)在深度負(fù)反饋條件下,該電路的電壓放大倍數(shù)是多少?
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最新試題
?在使用verilog描述一個(gè)二選一的數(shù)據(jù)選擇器時(shí),使用一條語句來進(jìn)行描述assign out1=(sel &b)∣(~sel &a),這條語句對應(yīng)的是()。
一塊通用面包板,公共條是三?四?三分段連通型,那么這塊板上最多有()個(gè)插孔在內(nèi)部是連通在一起的。
?CD放大器的性能特征有()。?
?電路如圖所示,如果電容C2開路,則MOSFET的漏極直流電壓將會(huì)(),漏極交流電壓將會(huì)(),增益將會(huì)()。
?某次電路實(shí)驗(yàn)中,一同學(xué)按如下電路圖連接電路,完成實(shí)驗(yàn)。其中D0,D1端為輸入端,S0與S1為輸出端。在實(shí)驗(yàn)過程中,該同學(xué)觀測到輸出端S0,S1端輸出電平分別為邏輯高電平,邏輯低電平。請問此刻電路輸入端D0,D1電平可能分別為()。
?TTL或非門組成的邏輯電路如圖所示,當(dāng)輸入為以下哪種狀態(tài)時(shí)會(huì)出現(xiàn)冒險(xiǎn)現(xiàn)象?()
?CS放大器中引入源極電阻RS,其作用有()。?
?verilogHDL的基本結(jié)構(gòu)中通常需要進(jìn)行模塊范圍的定義,VerilogHDL的模塊范圍的定義的開始和結(jié)束方式是()。
?數(shù)字頻率計(jì)設(shè)計(jì)中的測頻計(jì)數(shù)模塊共有多少個(gè)狀態(tài)?()
?verilogHDL中已經(jīng)預(yù)先定義了的門級原型的符號有()。