雙電源互補(bǔ)對稱電路如圖所示（T3的偏置電路未畫出），設(shè)輸入電壓Ui為正弦波，電源電壓Vcc=20V，RL=8Ω，T3管的電壓增益ΔUc3/ΔUb3=－10，射極輸出的電壓增益為1，T1、T2管的飽和管壓降可以忽略，試計(jì)算當(dāng)輸入電壓有效值Ui=1V時(shí)，電路的輸出功率POM，兩管的管耗PT，電源供給的功率PV以及效率η。
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試求：
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?6位7段數(shù)碼管動(dòng)態(tài)顯示模塊如圖，要求人眼看到所有數(shù)碼管同時(shí)顯示各自對應(yīng)的數(shù)字，控制數(shù)碼管位選信號的動(dòng)態(tài)掃描時(shí)鐘信號頻率約為多少？（）
?verilogHDL中已經(jīng)預(yù)先定義了的門級原型的符號有（）。
?MOSFET源極漏極間的長度L越大，溝道長度調(diào)制效應(yīng)越明顯。???
I=0.5mA，Vt=1.5V，k′n（W/L）=1mA/V2，VA足夠大。輸入輸出信號均通過電容耦合進(jìn)行傳輸（注意圖中未畫出電容），要實(shí)現(xiàn)增益為15倍的放大電路，則RD=（）kΩ。?
用作電壓放大器時(shí)，CS放大器不合適的參數(shù)為（）。?
?數(shù)字頻率計(jì)設(shè)計(jì)中的測頻計(jì)數(shù)模塊共有多少個(gè)狀態(tài)？（）
?在使用verilog描述一個(gè)二選一的數(shù)據(jù)選擇器時(shí)，使用一條語句來進(jìn)行描述assign out1=（sel &b）∣（~sel &a），這條語句對應(yīng)的是（）。
可以通過新增以下哪些類型文件添加ChipScope調(diào)試IP核？（）
現(xiàn)在定義了一個(gè)1位的加法器addbit（ci，a，b，co，sum），模塊的結(jié)果用表達(dá)式表示為{co，sub}=a+b+ci，其中a，b為兩個(gè)加數(shù)，ci為來自低位的進(jìn)位，sum為和，co為向高位的進(jìn)位，如果以此1位加法器構(gòu)建四位加法器，同時(shí)定義頂層模塊中的端口信號和中間變量的定義：下面通過層次調(diào)用的方式進(jìn)行邏輯實(shí)現(xiàn)中的表達(dá)式正確的是（）。
當(dāng)VGS=0時(shí)，能夠?qū)ǖ腗OS管為（）