單項(xiàng)選擇題結(jié)構(gòu)體中的變量應(yīng)在VHDL程序中（）部分給予說明。

A.結(jié)構(gòu)體對(duì)應(yīng)的實(shí)體的端口表中
B.結(jié)構(gòu)體中關(guān)鍵詞BEGIN前
C.結(jié)構(gòu)體中關(guān)鍵詞BEGIN后
D.程序包（PACKAGE）


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1.多項(xiàng)選擇題在VHDL程序中，以下4個(gè)部分，（）可以有順序執(zhí)行語句。

A.結(jié)構(gòu)體（ARCHITECTURE）
B.進(jìn)程（PROCESS）中的關(guān)鍵詞BEGIN前
C.進(jìn)程（PROCESS）中的關(guān)鍵詞BEGIN后
D.程序包（PACKAGE）

3.單項(xiàng)選擇題在VHDL語言中，ARCHITECTURE中的語句都是（）執(zhí)行的語句。

A.順序
B.并行
C.即可順序也可并行
D.無法確定

4.多項(xiàng)選擇題結(jié)構(gòu)體（ARCHITECTURE）用于描述設(shè)計(jì)單元的（）

A.行為、元件及連接關(guān)系
B.元件、子程序、公用數(shù)據(jù)類型
C.名稱和端口的引腳等
D.可編譯的設(shè)計(jì)單元

5.多項(xiàng)選擇題實(shí)體（ENTITY）描述一個(gè)設(shè)計(jì)單元的（）的信息。

A.行為、元件及連接關(guān)系
B.元件、子程序、公用數(shù)據(jù)類型
C.名稱和端口的引腳等
D.可編譯的設(shè)計(jì)單元

6.多項(xiàng)選擇題在邏輯代數(shù)中，下列推斷正確的是（）。

A、如果a+b=a+c，則b=c
B、如果ab=ac，則b=c
C、如果a*a=1，則a=1
D、如果a+a=a，則a=1

7.多項(xiàng)選擇題下列觸發(fā)器抗干擾能力較強(qiáng)的觸發(fā)器是（）。

A.基本RS觸發(fā)器
B.同步D觸發(fā)器
C.主從JK觸發(fā)器
D.維持－阻塞D觸發(fā)器

8.多項(xiàng)選擇題可編程邏輯器件GAL16V8可以定義成（）器件。

A.8入8出
B.16入2出
C.16入
D.1入8出

9.多項(xiàng)選擇題CMOS漏極開路門的特點(diǎn)有（）。

A.輸出MOS管的漏極是開路的
B.可以實(shí)現(xiàn)線與功能
C.可以用來實(shí)現(xiàn)邏輯電平轉(zhuǎn)換
D.帶負(fù)載能力強(qiáng)

10.多項(xiàng)選擇題下列器件屬于CMOS集成電路的是（）。

A.CD4511
B.CD4017
C.74LS373
D.74HC373

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判斷如下VHDL的操作是否正確，如不正確，請(qǐng)改正。字符a和b的數(shù)據(jù)類型是BIT，c是INTEGER，執(zhí)行c＜=a+b。

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