單項選擇題JK觸發(fā)器J與K相接作為一個輸入時相當(dāng)于（）觸發(fā)器。
A.JK
B.T
C.D
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1.單項選擇題CMOS反相器的優(yōu)點是（）
A.易飽和和截止
B.易維修
C.功耗小
D.功耗高
2.單項選擇題4位寄存器至少需要（）個觸發(fā)器構(gòu)成。
A.2
B.3
C.4
D.8
最新試題
?verilogHDL中已經(jīng)預(yù)先定義了的門級原型的符號有（）。
題型：多項選擇題
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題型：單項選擇題