A.50
B.60
C.80
D.100
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A.截止區(qū)
B.放大區(qū)
C.飽和區(qū)
D.以上都可以
A.發(fā)射結(jié)正偏，集電結(jié)反偏
B.發(fā)射結(jié)，集電結(jié)均正偏
C.發(fā)射極，集電結(jié)均反偏
D.發(fā)射結(jié)反偏，集電結(jié)正偏
A.正常
B.短路
C.斷路
D.被擊穿
A.P型半導(dǎo)體和N型半導(dǎo)體材料本身不帶電
B.P型半導(dǎo)體中，由于多數(shù)載流子為空穴，所以它帶正電
C.N型半導(dǎo)體中，由于多數(shù)載流子為自由電子，所以它帶負(fù)電
D.N型半導(dǎo)體中，由于多數(shù)載流子為空穴，所以它帶負(fù)電
由理想二極管組成的電路如圖所示，其A、B兩端的電壓為（）。
A.+6V
B.-6V
C.-18V
D.+18V
最新試題
?CS、CG和CD三種組態(tài)中，最適合做電壓放大器的還是CS放大器。
當(dāng)VGS=0時(shí)，能夠?qū)ǖ腗OS管為（）
?verilogHDL的基本結(jié)構(gòu)中通常需要進(jìn)行模塊范圍的定義，VerilogHDL的模塊范圍的定義的開始和結(jié)束方式是（）。
?verilogHDL中已經(jīng)預(yù)先定義了的門級(jí)原型的符號(hào)有（）。
?已知Nexys4開發(fā)板外部時(shí)鐘信號(hào)頻率為100MHz，數(shù)字鐘用來(lái)產(chǎn)生秒信號(hào)的時(shí)鐘信號(hào)頻率為1Hz，若采用計(jì)數(shù)器對(duì)100MHz的外部時(shí)鐘分頻得到1Hz的秒信號(hào)，請(qǐng)問(wèn)該計(jì)數(shù)器至少需要多少位？（）
?CD放大器的性能特征有（）。?
?CS放大器中引入源極電阻RS，其作用有（）。?
在下圖中如果輸入輸出均有電容耦合，則將RG的阻值由10MΩ替換為1MΩ時(shí)，柵極直流電壓將會(huì)（），漏極直流電流將會(huì)（），輸入電阻將會(huì)（）。
?若某放大器的輸入信號(hào)為電壓信號(hào)，輸出信號(hào)為電流信號(hào)，則以下描述正確的有（）。?
?數(shù)字頻率計(jì)采用4個(gè)數(shù)字的BCD碼計(jì)數(shù)器，若采樣時(shí)間0.01s，那么它能夠測(cè)量的最大頻率是多少？（）