一單電源互補(bǔ)對(duì)稱(chēng)功放電路如下圖所示,設(shè)Ui為正弦波,晶體管的飽和管壓降UCES可忽略不計(jì),最大不失真輸出功率為9W,求:
(1)電源電壓至少應(yīng)為多少?
(2)若輸入電壓Ui的最大有效值為8V,此時(shí)負(fù)載上能夠獲得的最大功率為多少
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CD放大器因?yàn)樵礃O輸出信號(hào)幾乎與柵極輸入信號(hào)變化一致,因此被稱(chēng)為“源極跟隨器”。
?在verilogHDL的數(shù)字表達(dá)方式用,和十進(jìn)制數(shù)127表示的數(shù)字相同的表達(dá)方式有()。
?數(shù)字頻率計(jì)采用4個(gè)數(shù)字的BCD碼計(jì)數(shù)器,若采樣時(shí)間0.01s,那么它能夠測(cè)量的最大頻率是多少?()
在對(duì)數(shù)字鐘計(jì)時(shí)、校時(shí)模塊進(jìn)行仿真時(shí),設(shè)秒信號(hào)的周期為10ns,若要觀察24時(shí)制計(jì)數(shù)是否正確,那么在復(fù)位信號(hào)無(wú)效,計(jì)時(shí)使能信號(hào)有效的情況下,仿真需運(yùn)行多長(zhǎng)時(shí)間?()
?數(shù)字頻率計(jì)設(shè)計(jì)中的測(cè)頻計(jì)數(shù)模塊共有多少個(gè)狀態(tài)?()
?CS放大器中引入源極電阻RS,其作用有()。?
?若某放大器的輸入信號(hào)為電壓信號(hào),輸出信號(hào)為電流信號(hào),則以下描述正確的有()。?
?verilogHDL的基本結(jié)構(gòu)中通常需要進(jìn)行模塊范圍的定義,VerilogHDL的模塊范圍的定義的開(kāi)始和結(jié)束方式是()。
用作電壓放大器時(shí),CS放大器不合適的參數(shù)為()。?
以下哪個(gè)MOS放大器組態(tài)結(jié)構(gòu)最適合用在電壓信號(hào)處理系統(tǒng)的最后一級(jí)??()