電路如圖所示,設(shè)UCC=12V,UEE=-12V,RL為8Ω的揚(yáng)聲器,輸入充分激勵(lì)時(shí)可得最大不失真的輸出功率。
(1)計(jì)算Pom;
(2)如再并上一個(gè)8Ω的揚(yáng)聲器,輸出功率有什么變化?
(3)在電源電壓不變的條件下,能否使每個(gè)揚(yáng)聲器發(fā)出和原來(lái)一樣大小的聲音?
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?CG放大器的性能描述合理的是()。
?電路如圖所示,如果電容C2開(kāi)路,則MOSFET的漏極直流電壓將會(huì)(),漏極交流電壓將會(huì)(),增益將會(huì)()。
?MOSFET源極漏極間的長(zhǎng)度L越大,溝道長(zhǎng)度調(diào)制效應(yīng)越明顯。???
可以通過(guò)新增以下哪些類(lèi)型文件添加ChipScope調(diào)試IP核?()
?在verilogHDL的數(shù)字表達(dá)方式用,和十進(jìn)制數(shù)127表示的數(shù)字相同的表達(dá)方式有()。
MOSFET做放大器,要想正常工作只需用電路提供合理的偏置使其工作在飽和區(qū)即可。???
假設(shè)NEMOSFET已工作在飽和區(qū),若uDS繼續(xù)增大時(shí),溝道夾斷點(diǎn)向漏極移動(dòng)。
在對(duì)數(shù)字鐘計(jì)時(shí)、校時(shí)模塊進(jìn)行仿真時(shí),設(shè)秒信號(hào)的周期為10ns,若要觀察24時(shí)制計(jì)數(shù)是否正確,那么在復(fù)位信號(hào)無(wú)效,計(jì)時(shí)使能信號(hào)有效的情況下,仿真需運(yùn)行多長(zhǎng)時(shí)間?()
CG放大器具有較()的輸入電阻和較()的輸出電阻。?
?verilog語(yǔ)法中,間隔符號(hào)主要包括()。